Medidor de capacitância em um chip lógico. Esquema, descrição

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Abaixo está um medidor de capacitância que é simples em termos de design de circuito, que até mesmo um rádio amador novato pode fazer. No entanto, o dispositivo tem uma precisão de medição de cerca de 4%, o que é bastante aceitável para muitos trabalhos de rádio amador.

Medidor de capacitância em um chip lógico

O dispositivo possui quatro subfaixas determinadas pela posição da chave SA1. Na posição 1, são medidos capacitores com capacitância de até 50 pF, 2 - até 500 pF, 3 - até 5000 pF e 4 - até 0,05 μF. Nos elementos DA1.1 e DA1.2 é feito um gerador de pulsos retangulares.

A frequência de geração depende da capacitância do capacitor e da resistência do resistor incluído no circuito de realimentação pelo interruptor. É maior na posição 1 do interruptor e menor na posição 4. Os elementos lógicos DD1.3 e DD1.4 são conectados em paralelo. Isso fornece uma corrente de carga suficientemente grande do capacitor medido Cx, que está conectado aos soquetes XS1 e XS2.

Aumentar a corrente de carga reduz o efeito da resistência de vazamento do capacitor Cx nas leituras do indicador. A indicação é realizada por um cabeçote de medição de ponteiro com uma corrente de deflexão total de 1 mA e uma resistência de quadro de 240 Ohm. Uma condição importante para a precisão do trabalho é a seleção dos diodos VD1 e VD2 - eles devem ser de alta frequência e ter os mesmos parâmetros.

O medidor de capacitância é ajustado separadamente para cada subfaixa. O interruptor de intervalo está definido para a posição apropriada. Um capacitor com uma capacitância precisamente conhecida é conectado aos soquetes. Ao ajustar um dos resistores de ajuste R1 - R 4 (da subfaixa correspondente), a leitura desejada é alcançada na escala do indicador.

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