Conversor de frequência digital 1. Esquema, descrição

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O nó descrito (ver figura), que implementa a função f1-f2, permite o uso de um frequencímetro como uma escala digital, o que não permite subtrair a frequência de um sinal da frequência de outro durante a medição.

Nos transistores VT1, VT2 e inversores do chip DD1, são montados oscilador local e condicionadores de sinal IF. Sua frequência é reduzida duas vezes pelos gatilhos DD2.1 e DD3.1.

(clique para ampliar)

Os sinais de meia frequência são alimentados respectivamente para as entradas de informação D dos gatilhos DD2.2, DD3.2 e o oscilador local (do shaper através do inversor) - para as entradas de sincronização C. O elemento EXCLUSIVE OR é feito nos elementos 2I-NOT do microcircuito DD4, da saída da qual uma sequência de pulso modulada em fase é obtida. A partir dele e do sinal do oscilador local, o gatilho DD5.1 gera pulsos com taxa de repetição fget / 2-fpch / 2, alimentados em um divisor de frequência por 50, feitos nos contadores binários DD6, DD7.

Pulsos com um ciclo de trabalho de 2 e uma frequência (fhet-fpch)/100 da saída 1 do contador DD7 são alimentados ao medidor de frequência. Se o ciclo de trabalho não precisar ser igual a 2, o contador DD7 pode ser excluído. Neste caso, a taxa de repetição dos pulsos de saída é igual a (fget-fpch)/10.

Autor: S. Zernin, Ussuriysk, Território de Primorsky; Publicação: N. Bolshakov, rf.atnn.ru

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