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Divisores de frequência fracionários. Enciclopédia de rádio eletrônica e engenharia elétrica

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Em alguns casos, para obter a frequência necessária ao usar um ressonador de quartzo existente, é necessário um divisor com fator de divisão não inteiro (múltiplo de 0,5). O autor fala sobre uma das variantes dessa divisória e o design prático de sua utilização.

A literatura descreve um método para reduzir o fator de divisão do contador em um usando o elemento "OU Exclusivo". Descobriu-se que este método também pode ser usado para obter um coeficiente de divisão fracionária. Como exemplo, considere o circuito da Fig. 1.

Divisores fracionários

O fator de divisão do contador DD2 na saída 4 é oito. Se um elemento DD1.1 estiver conectado à sua entrada, cada mudança no sinal na saída do contador levará a uma inversão do sinal na entrada CP do microcircuito DD2 (Fig. 2) e, como consequência, um anterior (em 1/2 do período do sinal de entrada) próxima mudança no estado do contador.

Divisores fracionários

Como resultado, a frequência de pulso na saída 4 do microcircuito DD2 será sete vezes menor que a da entrada e na saída 2 - 3,5 vezes. É importante observar aqui: se o ciclo de trabalho dos pulsos na saída do contador sem o elemento “OU Exclusivo” for igual a dois e um sinal de “onda quadrada” também for fornecido à entrada do divisor, um sinal da mesma forma é obtida na saída. Nessas condições, o sinal da penúltima saída 2 mantém sua periodicidade, mas seu ciclo de trabalho não é mais igual a dois, e o sinal da saída 1, embora tenha frequência média 1,75 vezes menor que a da saída, não é. periódico (mais precisamente, pares de pulsos são periódicos nele) .

Assim, para obter um divisor com fator de divisão terminando em 0,5, deve-se arredondar o fator requerido e dobrar o resultado. Como base do divisor necessário, pegue um contador com o fator de conversão resultante, cubra-o com feedback através do elemento “OU Exclusivo” e remova o sinal de saída do penúltimo estágio.

Vejamos um exemplo prático de utilização deste método. Para obter uma frequência de 440 Hz (diapasão eletrônico) a partir da frequência do ressonador de um relógio eletrônico (32 Hz), é necessário um divisor com coeficiente de 768.

Para obtê-lo, utiliza-se um divisor de frequência por 150, cujo fator de conversão é reduzido para 149 conectando o elemento “OU Exclusivo”, e o sinal de saída é retirado de sua penúltima saída.

O diagrama do dispositivo é mostrado na Fig. 3. O oscilador mestre é montado no elemento DD1.1. Ressalta-se que devido à assimetria das entradas dos elementos lógicos OR Exclusivos, tal gerador só funciona quando conectado à alimentação positiva das entradas 2, 5, 9 ou 12 [1]. O divisor de contrafrequência por 149 é montado nos microcircuitos DD2-DD4 e no elemento DD1.2. O fator de divisão de cada contador DD2 e DD3 é cinco. Seu sinal de saída é obtido das saídas 2 apenas para conveniência do layout da PCB; foi possível utilizar quaisquer saídas de 0 a 4. A divisão da frequência do sinal de saída do contador DD3 por seis (150 = 5x5x6) é realizada pelo chip DD4 - K176IE3.

Divisores fracionários

O principal objetivo deste chip é funcionar em um relógio eletrônico. Para uso neste dispositivo é interessante porque nas saídas b, c, e, f, g, 2 e p divide a frequência em seis, nas saídas a, d - em três, e em todas as saídas o sinal é periódico, incluindo a e d, e na saída f seu ciclo de trabalho é dois.

Portanto, se um sinal da saída f ("meandro") for fornecido à entrada inferior do elemento DD1.2 do circuito, na saída a ou d um sinal periódico é recebido com frequência 74,5 vezes menor que a original.

Diagramas de tempo na Fig. 4 ilustra que o sinal que aciona a porta XOR não precisa ter um ciclo de trabalho de dois. O dispositivo descrito utiliza um sinal da saída 2 do chip DD4. Seu ciclo de trabalho é 1,5. Apesar disso, a periodicidade dos pulsos na saída a é mantida. Isso acontece porque cada mudança no elemento de controle de sinal DD1.2 ocorre no início do pulso na saída a ou no meio. Como resultado, a duração dos pulsos nesta saída é reduzida pela metade do período da frequência de entrada, e as durações das pausas permanecem inalteradas (na Fig. 4, as durações dos pulsos e pausas entre eles são mostradas em períodos de frequência 32 Hz).

Divisores fracionários

Assim, na saída a do microcircuito DD4 é gerado um sinal com frequência de 440 Hz e ciclo de trabalho próximo de 1,5. É fornecido às entradas dos elementos buffer DD1.3 e DD1.4. O primeiro deles inverte o sinal de entrada, o segundo o repete. Um emissor de som piezoelétrico conectado entre as saídas desses elementos é alimentado com um sinal com oscilação (de pico a pico) igual ao dobro da tensão de alimentação, o que aumenta o volume do som, que é regulado pelo resistor R4. A corrente consumida da bateria não excede 5 mA.

O circuito diferenciador C3R3 foi projetado para definir corretamente os gatilhos do chip DD4 ao seu estado original. O fato é que os contadores dos microcircuitos K176IE3, K176IE4, K561IE9, K561IE8, K176IE8 são baseados em registradores de deslocamento com conexões cruzadas, e seus gatilhos podem ser configurados para um estado arbitrário quando ligados. Para os três últimos tipos de microcircuitos isso não importa, pois eles contêm circuitos para corrigir automaticamente o estado inicial incorreto e, após aplicar vários pulsos de clock neles, passar para o estado permitido [2].

Os microcircuitos K176IE3 e K176IE4 não contêm tais circuitos, portanto, sem configurar inicialmente os gatilhos para o estado desejado, eles podem não funcionar corretamente.

Literatura

  1. Biryukov S. Geradores e modeladores de pulso em microcircuitos CMOS. - Rádio, 1995, nº 7, p. 36, 37; Nº 9, pág. 54, 55.
  2. Alekseev S. Aplicação de microcircuitos da série K561. - Rádio, 1986, nº 11, p. 33-36; Nº 12, pág. 42-46; 1987, nº 1, pág. 43-45.

Autor: S. Biryukov, Moscou

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